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Xbox 360

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Trabalho Acadêmico Universidade Federal de Lavras Disciplina: Organização de Computadores Objetivo do trabalho: Realizar uma análise do console, relacionando os princípios técnicos abordados na disciplina.

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Bruno DetomiDiego Marcolino

José Alair da SilvaLuiz Henrique Faleiro

Thiago Nascimento

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O Console

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LançamentoApresentado oficialmente em 12 de maio de 2005 pela MTV EUA.

Data do lançamento oficial nas respectivas localidades:

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Empresas envolvidas

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Competição no Mercado

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Versões

XBOX 360 PremiumXBOX 360 Elite XBOX 360 Arcade

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Hardware

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Arquitetura

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CPU - Processador• Processador Xenon – 3Core• Desempenho matemático de jogos:

– 19,2 bilhões de operações de produto escalar por segundo.

(Baseada na IBM Power PC)

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GPU – Processador Gráfico

• Processador personalizado da ATI – Xenos• 10MB de DRAM incorporado• Elaborado sistema de Shaders

(ATI Xenos)

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Memória

• 512MB de 700MHz GDDR3 RAM• Arquitetura de memória unificada

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Armazenamento• Disco Rígido - atualizável e remoível (SATA):

– 20gb, 40gb (Premium)– 120Gb (Elite)

• 12x DVD-ROM de camada dupla

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Entrada / Saída

• Suporte para até quatro controles sem fio• Três portas USB 2.0• Dois slots de unidades de memória

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Áudio

• Saída Surround de múltiplos canais;

• Processamento de áudio de 32 bits.

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Saída de Vídeo

• Todos os jogos suportam resolução 4:3 e 16:9

• Resolução de 480i, 480p, 720p, 1080i e até 1080p (FullHD)

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Saída de Vídeo

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CPU• Processador Xenon– 165 milhões de transistores

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Processador Xenon

• Cache L2 de 1MB com bus de 256bits - largura de banda de 21.6Gb/s

• Um cache L1 de dados e instruções de 32kb.

• O processador segue um novo design, de nome VMX128.

• 128 registros com endereçamento direto.

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A Cache L2 do Xenon

• O Xenon possui uma cache L2 de 1Mb compartilhada para os três núcleos.

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Comunicação entre Núcleos e Cache

• Primeiro sua comunicação é através de um crossbar , operando em máxima frequência.

• O restante é operado com metade da frequência do Processador.

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Comunicação entre Núcleos e Cache

• Cada núcleo tem 8 Buffers não seqüenciais.

• Pedidos que não são passíveis de ficar em cache seguem outro caminho de dados através de quatro buffers por cada core.

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A Cache

• A cache L2 no seu todo suporta uma escrita e leitura em freqüência alta muito elevada (Largura de banda).

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Tamanho da Cache

• Talvez uma cache de apenas 1Mb seja muito pequena pra uma CPU de 3 Cores.

• No entanto, existem duas boas razões para o relativo pequeno tamanho desta cache.

– Tamanho físico.

– Para aplicações para as quais o Xenon foi concebido para executar não utilizam a cache de forma muito eficiente.

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Bruno DetomiDiego Marcolino

José Alair da SilvaLuiz Henrique Faleiro

Thiago Nascimento

Obrigado.